教你巧妙降低噪聲與電磁干擾

時間：2019-09-05

電子設備的活絡度越來越高，這需要設備的抗煩擾才干也越來越強，因此PCB計劃也變得加困難，怎么提高PCB的抗干擾能力成為許多工程師們重視的關鍵疑問之一。ADI中文技術支持共享的《PCB計劃：降低噪聲與電磁煩擾的24個竅門》為PCB計劃中降低噪聲與電磁煩擾供應了非常有用的建議，值得筒子們閱讀保藏。

1.時鐘產生器盡量近到用該時鐘的器件，石英晶體振蕩器外殼要接地.

2.可用串一個電阻的辦法，降低控制電路上下沿跳變速率。

3.用地線將時鐘區(qū)圈起來，時鐘線盡量短。

4.擱置不用的門電路輸入端不要懸空，擱置不用的運放正輸入端接地，負輸入端接輸出端。

5.印制板按頻率和電流開關特性分區(qū)，噪聲元件與非噪聲元件要距離再遠一些。

6.仿照電壓輸入線、參看電壓端要盡量遠離數(shù)字電路信號線，特別是時鐘。

7.時鐘線垂直于I/O 線比平行I/O 線煩擾小，時鐘元件引腳遠離I/O 電纜。

8.要害的線要盡量粗，并在兩端加上保護地。高速線要短要直。

9.石英晶體下面以及對噪聲活絡的器件下面不要走線。

10.信號都不要構成環(huán)路，如不可避免，讓環(huán)路區(qū)盡量小。

11.用大容量的鉭電容或聚酷電容而不用電解電容作電路充放電儲能電容。運用管狀電容時，外殼要接地。

12.對噪聲活絡的線不要與大電流，高速開關線平行。

13.弱信號電路，低頻電路周圍不要構成電流環(huán)路。

14.每個集成電路一個去耦電容。每個電解電容邊上都要加一個小的高頻旁路電容。

15.單面板和雙面板用單點接電源和單點接地、電源線、地線盡量粗，經濟是能接受的話用多層板以減小電源，地的容生電感。

16.印制板盡量，運用45 折線而不用90 折線布線以減小高頻信號對外的**與耦合。

17.I/O 驅動電路盡量近打印板邊，讓其從速脫離打印板;對進入印制板的信號要加濾波，從高噪聲區(qū)來的信號也要加濾波，一起用串終端電阻的辦法，減小信號反射。

18.MCD 無用端要接高，或接地，或定義成輸出端，集成電路上該接電源地的端都要接，不要懸空。

19.能用低速芯片就不用高速的，高速芯片用在要害本地。

20.運用滿意系統(tǒng)需要的低頻率時鐘。

21.時鐘、總線、片選信號要遠離I/O 線和接插件。

22.對A/D 類器件，數(shù)字有些與仿照有些寧可共同下也不要交叉。

23.元件引腳盡量短，去耦電容引腳盡量短。

24.盡量為繼電器等供應某種方式的阻尼。

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